219 lines
4.3 KiB
C
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4.3 KiB
C
/* SPDX-License-Identifier: BSD-3-Clause */
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/*
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* Altera SoCFPGA PinMux configuration
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*/
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#ifndef __SOCFPGA_PINMUX_CONFIG_H__
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#define __SOCFPGA_PINMUX_CONFIG_H__
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const u8 sys_mgr_init_table[] = {
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0, /* EMACIO0 */
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2, /* EMACIO1 */
|
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2, /* EMACIO2 */
|
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|
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|
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|
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2, /* MIXED1IO10 */
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2, /* MIXED1IO11 */
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1, /* GPLMUX5 */
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1, /* GPLMUX6 */
|
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1, /* GPLMUX7 */
|
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1, /* GPLMUX8 */
|
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1, /* GPLMUX9 */
|
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1, /* GPLMUX10 */
|
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1, /* GPLMUX11 */
|
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1, /* GPLMUX12 */
|
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1, /* GPLMUX13 */
|
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1, /* GPLMUX14 */
|
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1, /* GPLMUX15 */
|
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1, /* GPLMUX16 */
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1, /* GPLMUX17 */
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1, /* GPLMUX18 */
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|
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1, /* GPLMUX20 */
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|
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|
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|
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|
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|
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|
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1, /* GPLMUX30 */
|
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1, /* GPLMUX31 */
|
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1, /* GPLMUX32 */
|
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1, /* GPLMUX33 */
|
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1, /* GPLMUX34 */
|
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1, /* GPLMUX35 */
|
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1, /* GPLMUX36 */
|
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1, /* GPLMUX37 */
|
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1, /* GPLMUX38 */
|
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1, /* GPLMUX39 */
|
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1, /* GPLMUX40 */
|
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1, /* GPLMUX41 */
|
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|
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|
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|
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|
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|
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|
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1, /* GPLMUX48 */
|
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|
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1, /* GPLMUX50 */
|
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1, /* GPLMUX51 */
|
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1, /* GPLMUX52 */
|
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1, /* GPLMUX53 */
|
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1, /* GPLMUX54 */
|
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1, /* GPLMUX55 */
|
|
1, /* GPLMUX56 */
|
|
1, /* GPLMUX57 */
|
|
1, /* GPLMUX58 */
|
|
1, /* GPLMUX59 */
|
|
1, /* GPLMUX60 */
|
|
1, /* GPLMUX61 */
|
|
1, /* GPLMUX62 */
|
|
1, /* GPLMUX63 */
|
|
1, /* GPLMUX64 */
|
|
1, /* GPLMUX65 */
|
|
1, /* GPLMUX66 */
|
|
1, /* GPLMUX67 */
|
|
1, /* GPLMUX68 */
|
|
1, /* GPLMUX69 */
|
|
1, /* GPLMUX70 */
|
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0, /* NANDUSEFPGA */
|
|
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|
|
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|
|
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|
|
0, /* CAN0USEFPGA */
|
|
0, /* I2C0USEFPGA */
|
|
0, /* SDMMCUSEFPGA */
|
|
0, /* QSPIUSEFPGA */
|
|
0, /* SPIS1USEFPGA */
|
|
0, /* RGMII0USEFPGA */
|
|
0, /* UART1USEFPGA */
|
|
0, /* CAN1USEFPGA */
|
|
0, /* USB1USEFPGA */
|
|
0, /* I2C3USEFPGA */
|
|
0, /* I2C2USEFPGA */
|
|
0, /* I2C1USEFPGA */
|
|
0, /* SPIM1USEFPGA */
|
|
0, /* USB0USEFPGA */
|
|
0 /* SPIM0USEFPGA */
|
|
};
|
|
#endif /* __SOCFPGA_PINMUX_CONFIG_H__ */
|