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4.6 KiB
C
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C
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// SPDX-License-Identifier: GPL-2.0-or-later
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/*
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* the IDE Virtual Support Module of AMD CS5536
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* Copyright (C) 2007 Lemote, Inc.
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|
* Author : jlliu, liujl@lemote.com
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*
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|
* Copyright (C) 2009 Lemote, Inc.
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|
* Author: Wu Zhangjin, wuzhangjin@gmail.com
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*/
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#include <cs5536/cs5536.h>
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|
#include <cs5536/cs5536_pci.h>
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void pci_ide_write_reg(int reg, u32 value)
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{
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u32 hi = 0, lo = value;
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switch (reg) {
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case PCI_COMMAND:
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_rdmsr(GLIU_MSR_REG(GLIU_PAE), &hi, &lo);
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if (value & PCI_COMMAND_MASTER)
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lo |= (0x03 << 4);
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|
else
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lo &= ~(0x03 << 4);
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|
_wrmsr(GLIU_MSR_REG(GLIU_PAE), hi, lo);
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break;
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|
case PCI_STATUS:
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if (value & PCI_STATUS_PARITY) {
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||
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|
_rdmsr(SB_MSR_REG(SB_ERROR), &hi, &lo);
|
||
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if (lo & SB_PARE_ERR_FLAG) {
|
||
|
|
lo = (lo & 0x0000ffff) | SB_PARE_ERR_FLAG;
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||
|
|
_wrmsr(SB_MSR_REG(SB_ERROR), hi, lo);
|
||
|
|
}
|
||
|
|
}
|
||
|
|
break;
|
||
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|
case PCI_CACHE_LINE_SIZE:
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value &= 0x0000ff00;
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|
_rdmsr(SB_MSR_REG(SB_CTRL), &hi, &lo);
|
||
|
|
hi &= 0xffffff00;
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|
hi |= (value >> 8);
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|
|
_wrmsr(SB_MSR_REG(SB_CTRL), hi, lo);
|
||
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|
break;
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|
|
case PCI_BAR4_REG:
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|
if (value == PCI_BAR_RANGE_MASK) {
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|
|
_rdmsr(GLCP_MSR_REG(GLCP_SOFT_COM), &hi, &lo);
|
||
|
|
lo |= SOFT_BAR_IDE_FLAG;
|
||
|
|
_wrmsr(GLCP_MSR_REG(GLCP_SOFT_COM), hi, lo);
|
||
|
|
} else if (value & 0x01) {
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_IO_BAR), &hi, &lo);
|
||
|
|
lo = (value & 0xfffffff0) | 0x1;
|
||
|
|
_wrmsr(IDE_MSR_REG(IDE_IO_BAR), hi, lo);
|
||
|
|
|
||
|
|
value &= 0xfffffffc;
|
||
|
|
hi = 0x60000000 | ((value & 0x000ff000) >> 12);
|
||
|
|
lo = 0x000ffff0 | ((value & 0x00000fff) << 20);
|
||
|
|
_wrmsr(GLIU_MSR_REG(GLIU_IOD_BM2), hi, lo);
|
||
|
|
}
|
||
|
|
break;
|
||
|
|
case PCI_IDE_CFG_REG:
|
||
|
|
if (value == CS5536_IDE_FLASH_SIGNATURE) {
|
||
|
|
_rdmsr(DIVIL_MSR_REG(DIVIL_BALL_OPTS), &hi, &lo);
|
||
|
|
lo |= 0x01;
|
||
|
|
_wrmsr(DIVIL_MSR_REG(DIVIL_BALL_OPTS), hi, lo);
|
||
|
|
} else {
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_CFG), &hi, &lo);
|
||
|
|
lo = value;
|
||
|
|
_wrmsr(IDE_MSR_REG(IDE_CFG), hi, lo);
|
||
|
|
}
|
||
|
|
break;
|
||
|
|
case PCI_IDE_DTC_REG:
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_DTC), &hi, &lo);
|
||
|
|
lo = value;
|
||
|
|
_wrmsr(IDE_MSR_REG(IDE_DTC), hi, lo);
|
||
|
|
break;
|
||
|
|
case PCI_IDE_CAST_REG:
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_CAST), &hi, &lo);
|
||
|
|
lo = value;
|
||
|
|
_wrmsr(IDE_MSR_REG(IDE_CAST), hi, lo);
|
||
|
|
break;
|
||
|
|
case PCI_IDE_ETC_REG:
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_ETC), &hi, &lo);
|
||
|
|
lo = value;
|
||
|
|
_wrmsr(IDE_MSR_REG(IDE_ETC), hi, lo);
|
||
|
|
break;
|
||
|
|
case PCI_IDE_PM_REG:
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_INTERNAL_PM), &hi, &lo);
|
||
|
|
lo = value;
|
||
|
|
_wrmsr(IDE_MSR_REG(IDE_INTERNAL_PM), hi, lo);
|
||
|
|
break;
|
||
|
|
default:
|
||
|
|
break;
|
||
|
|
}
|
||
|
|
}
|
||
|
|
|
||
|
|
u32 pci_ide_read_reg(int reg)
|
||
|
|
{
|
||
|
|
u32 conf_data = 0;
|
||
|
|
u32 hi, lo;
|
||
|
|
|
||
|
|
switch (reg) {
|
||
|
|
case PCI_VENDOR_ID:
|
||
|
|
conf_data =
|
||
|
|
CFG_PCI_VENDOR_ID(CS5536_IDE_DEVICE_ID, CS5536_VENDOR_ID);
|
||
|
|
break;
|
||
|
|
case PCI_COMMAND:
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_IO_BAR), &hi, &lo);
|
||
|
|
if (lo & 0xfffffff0)
|
||
|
|
conf_data |= PCI_COMMAND_IO;
|
||
|
|
_rdmsr(GLIU_MSR_REG(GLIU_PAE), &hi, &lo);
|
||
|
|
if ((lo & 0x30) == 0x30)
|
||
|
|
conf_data |= PCI_COMMAND_MASTER;
|
||
|
|
break;
|
||
|
|
case PCI_STATUS:
|
||
|
|
conf_data |= PCI_STATUS_66MHZ;
|
||
|
|
conf_data |= PCI_STATUS_FAST_BACK;
|
||
|
|
_rdmsr(SB_MSR_REG(SB_ERROR), &hi, &lo);
|
||
|
|
if (lo & SB_PARE_ERR_FLAG)
|
||
|
|
conf_data |= PCI_STATUS_PARITY;
|
||
|
|
conf_data |= PCI_STATUS_DEVSEL_MEDIUM;
|
||
|
|
break;
|
||
|
|
case PCI_CLASS_REVISION:
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_CAP), &hi, &lo);
|
||
|
|
conf_data = lo & 0x000000ff;
|
||
|
|
conf_data |= (CS5536_IDE_CLASS_CODE << 8);
|
||
|
|
break;
|
||
|
|
case PCI_CACHE_LINE_SIZE:
|
||
|
|
_rdmsr(SB_MSR_REG(SB_CTRL), &hi, &lo);
|
||
|
|
hi &= 0x000000f8;
|
||
|
|
conf_data = CFG_PCI_CACHE_LINE_SIZE(PCI_NORMAL_HEADER_TYPE, hi);
|
||
|
|
break;
|
||
|
|
case PCI_BAR4_REG:
|
||
|
|
_rdmsr(GLCP_MSR_REG(GLCP_SOFT_COM), &hi, &lo);
|
||
|
|
if (lo & SOFT_BAR_IDE_FLAG) {
|
||
|
|
conf_data = CS5536_IDE_RANGE |
|
||
|
|
PCI_BASE_ADDRESS_SPACE_IO;
|
||
|
|
lo &= ~SOFT_BAR_IDE_FLAG;
|
||
|
|
_wrmsr(GLCP_MSR_REG(GLCP_SOFT_COM), hi, lo);
|
||
|
|
} else {
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_IO_BAR), &hi, &lo);
|
||
|
|
conf_data = lo & 0xfffffff0;
|
||
|
|
conf_data |= 0x01;
|
||
|
|
conf_data &= ~0x02;
|
||
|
|
}
|
||
|
|
break;
|
||
|
|
case PCI_CARDBUS_CIS:
|
||
|
|
conf_data = PCI_CARDBUS_CIS_POINTER;
|
||
|
|
break;
|
||
|
|
case PCI_SUBSYSTEM_VENDOR_ID:
|
||
|
|
conf_data =
|
||
|
|
CFG_PCI_VENDOR_ID(CS5536_IDE_SUB_ID, CS5536_SUB_VENDOR_ID);
|
||
|
|
break;
|
||
|
|
case PCI_ROM_ADDRESS:
|
||
|
|
conf_data = PCI_EXPANSION_ROM_BAR;
|
||
|
|
break;
|
||
|
|
case PCI_CAPABILITY_LIST:
|
||
|
|
conf_data = PCI_CAPLIST_POINTER;
|
||
|
|
break;
|
||
|
|
case PCI_INTERRUPT_LINE:
|
||
|
|
conf_data =
|
||
|
|
CFG_PCI_INTERRUPT_LINE(PCI_DEFAULT_PIN, CS5536_IDE_INTR);
|
||
|
|
break;
|
||
|
|
case PCI_IDE_CFG_REG:
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_CFG), &hi, &lo);
|
||
|
|
conf_data = lo;
|
||
|
|
break;
|
||
|
|
case PCI_IDE_DTC_REG:
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_DTC), &hi, &lo);
|
||
|
|
conf_data = lo;
|
||
|
|
break;
|
||
|
|
case PCI_IDE_CAST_REG:
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_CAST), &hi, &lo);
|
||
|
|
conf_data = lo;
|
||
|
|
break;
|
||
|
|
case PCI_IDE_ETC_REG:
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_ETC), &hi, &lo);
|
||
|
|
conf_data = lo;
|
||
|
|
break;
|
||
|
|
case PCI_IDE_PM_REG:
|
||
|
|
_rdmsr(IDE_MSR_REG(IDE_INTERNAL_PM), &hi, &lo);
|
||
|
|
conf_data = lo;
|
||
|
|
break;
|
||
|
|
default:
|
||
|
|
break;
|
||
|
|
}
|
||
|
|
|
||
|
|
return conf_data;
|
||
|
|
}
|